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Ingénieur RTL verification FPGA/ASIC (H/F) 13 - AIX EN PROVENCE
Offre n° 5181898
Ingénieur RTL verification FPGA/ASIC (H/F)
13 - AIX EN PROVENCE - Localiser avec Mappy
Actualisé le 02 mai 2024
Offer descriptionDans le cadre d'un projet spécifique, basé sur une architecture à base de ASIC type SoC, nous recrutons un(e) Ingénieur(e) en microélectronique numérique pour assurer une partie du développement.Le télétravail est possible selon les cas (2 jours par semaine). Vos missions : Construire le test plan fonctionnel et l'environnement de vérification ;Créer des modèles de vérification de l'IP (SystemVerilog, python) ;Réaliser le codage et exécuter des tests (non-régression) à l'aide d'outils de simulation RTL (Questasim/Modelsim/Xcelium/VCS) ;Analyser la couverture (code coverage / functional coverage) ;Rédiger des rapports de vérificationDévelopper des modèles d'IP synthétisables pour cible FPGA ;Être en support aux équipes Software et Intégration Pour mener à bien cette mission, vous devrez : Appréhender le fonctionnement du produit afin d'apporter un regard pertinent sur les solutions choisiesTravailler avec les développeurs pour qualifier les nouveaux développementsCollaborer avec d'autres équipes, notamment Firmware et Hardware dans un contexte Agile ou Cycle en VAssurer un reporting hebdomadaire de vos tâches et votre avancement. Il y a plusieurs postes, avec de la place pour des débutants mais aussi et surtout pour des développeurs plus expérimentés.Required profileTitulaire d'un diplôme d'ingénieur en électronique ou d'un diplôme universitaire équivalent avec une première experience de préférence dans le domaine de la microélectronique numérique. Votre passion, votre dynamisme et votre capacité à transmettre dans des contextes variables seront des atouts pour vous épanouir dans ce rôle. Compétences recherchées et/ou à développer Maîtrise de la vérification RTL (tests dirigés ou randomisés, testbench VDHL ou System Verilog)Solides connaissances dans les processus de développement d'un ASICExpérience en synthèse FPGA ou ASICAnalyse, réutilisation et modification de blocs complexesPratique de la gestion de configuration (Git, SVN, ClearCase)Méthodologie du cycle en V et AgileConnaissance ou intérêt pour la thématique de reconnaissance visuelleBonne compréhension en anglais technique (écrit et oral) Qualités requises Avoir une capacité d'apprentissage et une rigueur dans l'exécutionSavoir travailler en équipe et avoir le sens du serviceAvoir une certaine facilité à communiquer avec différents types d'interlocuteurs
- Type de contrat
-
Contrat à durée indéterminée
Contrat travail
Profil souhaité
Expérience
- Expérience exigéeCette expérience est indispensable
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